Architectural synthesis of high-level analogue VHDL-AMS descriptions using netlist extraction from parse trees

  1. Doménech-Asensi, G.
  2. Kazmierski, T.J.
  3. Ruiz-Marin, J.D.
  4. Ruiz-Merino, R.
Revista:
Electronics Letters

ISSN: 0013-5194

Año de publicación: 2000

Volumen: 36

Número: 20

Páginas: 1680-1682

Tipo: Artículo

DOI: 10.1049/EL:20001202 GOOGLE SCHOLAR
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